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明(míng)德揚詳细(xì)图(tú)文(wén)解(jiě)说(shuō)PLL的(de)使用(yòng)过(guò)程

發(fà)布(bù)时(shí)間(jiān):2022-02-16   作者(zhě):lishuangshun 浏覽量(liàng):

PLL(Phase Locked Loop): 为(wèi)鎖相回(huí)路(lù)或(huò)鎖相环(huán),用(yòng)来(lái)統一(yī)整合时(shí)鐘(zhōng)信(xìn)号(hào),使高(gāo)頻器件(jiàn)正(zhèng)常工作,如(rú)內(nèi)存的(de)存取(qǔ)資料等。PLL用(yòng)于(yú)振蕩器中(zhōng)的(de)反(fǎn)饋技術(shù)。 许多(duō)電(diàn)子設備要(yào)正(zhèng)常工作,通(tòng)常需要(yào)外(wài)部(bù)的(de)輸入(rù)信(xìn)号(hào)與(yǔ)內(nèi)部(bù)的(de)振蕩信(xìn)号(hào)同(tóng)步。一(yī)般的(de)晶振由(yóu)于(yú)工藝與(yǔ)成(chéng)本(běn)原因(yīn),做不(bù)到(dào)很高(gāo)的(de)頻率,而(ér)在(zài)需要(yào)高(gāo)頻應(yìng)用(yòng)时(shí),由(yóu)相應(yìng)的(de)器件(jiàn)VCO,实現(xiàn)轉(zhuǎn)成(chéng)高(gāo)頻,但并不(bù)稳定(dìng),故利用(yòng)鎖相环(huán)路(lù)就(jiù)可(kě)以(yǐ)实現(xiàn)稳定(dìng)且高(gāo)頻的(de)时(shí)鐘(zhōng)信(xìn)号(hào)。

 

一(yī)、PLL作用(yòng):用(yòng)于(yú)生(shēng)成(chéng)我(wǒ)们(men)設計(jì)所(suǒ)需要(yào)的(de)时(shí)鐘(zhōng)頻率

1、将輸入(rù)的(de)时(shí)鐘(zhōng)進(jìn)行倍頻和(hé)分(fēn)頻,并且其相位偏移、占空比等和(hé)等都可(kě)以(yǐ)控制。

2、倍頻只(zhī)能(néng)通(tòng)过(guò)PLL来(lái)实現(xiàn)。l

3、當FPGA有(yǒu)PLL时(shí),建議用(yòng)PLL生(shēng)成(chéng)所(suǒ)需要(yào)的(de)时(shí)鐘(zhōng)頻率。不(bù)建議通(tòng)过(guò)計(jì)數器分(fēn)頻等来(lái)实現(xiàn)。

 

二(èr)、要(yào)求:无需深究其運行機(jī)理,主(zhǔ)要(yào)会(huì)用(yòng),在(zài)quartusII里(lǐ)面(miàn)可(kě)以(yǐ)直(zhí)接生(shēng)成(chéng)。

 

过(guò)程如(rú)下(xià)步驟:

 

1. 打(dǎ)開(kāi)IP核管(guǎn)理工具

A、打(dǎ)開(kāi)quartus软(ruǎn)件(jiàn)

B、Tools -> MegaWizard,弹出(chū)如(rú)下(xià)界面(miàn)

C、默認選擇生(shēng)成(chéng)新的(de)IP文(wén)件(jiàn),選next。弹出(chū)如(rú)下(xià)窗(chuāng)口(kǒu)。

D、按图(tú)上(shàng)選擇ALTPLL,并且在(zài)右(yòu)邊(biān)起个(gè)文(wén)件(jiàn)名。然後(hòu)點(diǎn)Next就(jiù)可(kě)以(yǐ)開(kāi)始設置參數了(le)。

 

2. 設置IP參數

 

上(shàng)图(tú)中(zhōng),主(zhǔ)要(yào)是(shì)設置輸入(rù)的(de)时(shí)鐘(zhōng)頻率,例如(rú)明(míng)德揚開(kāi)發(fà)板輸入(rù)时(shí)鐘(zhōng)是(shì)固定(dìng)的(de)50MHz,因(yīn)此(cǐ)此(cǐ)时(shí)可(kě)填写50。其他(tā)默認,按next。


 

上(shàng)图(tú)1中(zhōng),關(guān)注是(shì)否要(yào)有(yǒu)複位信(xìn)号(hào)。如(rú)果(guǒ)項目需要(yào)複位,則勾選,不(bù)需要(yào)則不(bù)勾選。

 

上(shàng)图(tú)2中(zhōng),問(wèn)是(shì)否要(yào)有(yǒu)locked指示信(xìn)号(hào)。該信(xìn)号(hào)为(wèi)1,表(biǎo)示时(shí)鐘(zhōng)輸出(chū)稳定(dìng)可(kě)用(yòng)。可(kě)根(gēn)據(jù)需要(yào)勾選。


設置c0的(de)輸出(chū)頻率。PLL的(de)每个(gè)頻率都有(yǒu)一(yī)个(gè)預scale系(xì)數(N)和(hé)一(yī)个(gè)乘法系(xì)數(M),範圍從1到(dào)32。其輸出(chū)公式为(wèi):輸出(chū)时(shí)鐘(zhōng)頻率=輸入(rù)时(shí)鐘(zhōng)頻率*(M/N)輸出(chū)的(de)时(shí)鐘(zhōng)頻率只(zhī)能(néng)由(yóu)上(shàng)述公式産生(shēng),如(rú)果(guǒ)産生(shēng)不(bù)了(le),則会(huì)提(tí)示報錯。如(rú)下(xià)图(tú)。

 

 

   拓展(zhǎn)閱读(dú)
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