SDRAM 接口(kǒu)設計(jì)與(yǔ) DDR3 iP 核使用(yòng)課程介紹
一(yī)、課程优勢：
1.SDRAM和(hé)DDR3全(quán)掌握;
2.SDRAM重(zhòng)設計(jì);DDR3重(zhòng)使用(yòng);
3.SDRAM數據(jù)手(shǒu)册的(de)閱读(dú)方(fāng)法;
4.超精簡的(de)代(dài)碼設計(jì)方(fāng)法;課程講解(jiě)细(xì)致(zhì)
二(èr)、适合人(rén)群(qún)：
1.項目急需用(yòng)DDR3的(de)FPGA工程师(shī)
2.畢業設計(jì)需用(yòng)到(dào)SDRAM/DDR3的(de)学生(shēng)
3.SDRAM/DDR3經(jīng)验(yàn)提(tí)高(gāo)競争力的(de)求職者(zhě)
三(sān)、內(nèi)容簡介：
本(běn)課程以(yǐ)講解(jiě)SDRAM控制器为(wèi)主(zhǔ)，DDR3是(shì)使用(yòng)IP核的(de)。代(dài)碼量(liàng)較少(shǎo)，
但難度(dù)較大。DDR3主(zhǔ)要(yào)是(shì)实操为(wèi)主(zhǔ)，不(bù)講協議。
（1）SDRAM 接口(kǒu)設計(jì)部(bù)分(fēn)
（2）DDR3 IP 核使用(yòng)部(bù)分(fēn) 基于(yú) xilinx K7 系(xì)列的(de) DDR3 IP 核使用(yòng)
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