时(shí)序邏輯always語(yǔ)句(jù)

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1、本(běn)节(jié)主(zhǔ)要(yào)介紹，时(shí)序邏輯的(de)代(dài)碼，一(yī)般有(yǒu)两(liǎng)種(zhǒng)：同(tóng)步複位时(shí)序邏輯和(hé)异(yì)步複位时(shí)序邏輯（本(běn)教学統一(yī)采用(yòng)异(yì)步时(shí)鐘(zhōng)邏輯）；D型觸發(fà)器的(de)介紹，包(bāo)括：D觸發(fà)器的(de)結構、波(bō)形、代(dài)碼以(yǐ)及(jí)如(rú)何看(kàn)FPGA波(bō)形；时(shí)鐘(zhōng)的(de)介紹，时(shí)鐘(zhōng)的(de)意(yì)義，时(shí)鐘(zhōng)頻率和(hé)时(shí)鐘(zhōng)周期(qī)的(de)換算；时(shí)序邏輯代(dài)碼和(hé)硬(yìng)件(jiàn)的(de)關(guān)系(xì)，即評估verilog代(dài)碼好(hǎo)壞的(de)最(zuì)基本(běn)标(biāo)準，不(bù)是(shì)看(kàn)代(dài)碼行數而(ér)是(shì)看(kàn)硬(yìng)件(jiàn)；阻塞賦值和(hé)非(fēi)阻塞賦值，前(qián)者(zhě)位順序賦值，後(hòu)者(zhě)位同(tóng)时(shí)賦值。
2、这(zhè)是(shì)ALTERA和(hé)VIVADO文(wén)檔

第(dì)6节(jié) 功能(néng)描述-时(shí)序邏輯

时(shí)序邏輯的(de)代(dài)碼一(yī)般有(yǒu)两(liǎng)種(zhǒng)：同(tóng)步複位的(de)时(shí)序邏輯和(hé)异(yì)步複位的(de)时(shí)序邏輯。在(zài)同(tóng)步複位的(de)时(shí)序邏輯中(zhōng)複位不(bù)是(shì)立即有(yǒu)效，

而(ér)在(zài)时(shí)鐘(zhōng)上(shàng)升(shēng)沿时(shí)複位才有(yǒu)效。

为(wèi)了(le)教学的(de)方(fāng)便，笔(bǐ)者(zhě)的(de)代(dài)碼統一(yī)采用(yòng)异(yì)步时(shí)鐘(zhōng)邏輯，建議同(tóng)学们(men)都采用(yòng)此(cǐ)結構，

这(zhè)樣(yàng)設計(jì)时(shí)只(zhī)需考慮是(shì)用(yòng)时(shí)序邏輯還(huán)是(shì)組合邏輯結構来(lái)進(jìn)行代(dài)碼編写即可(kě)。

在(zài)实際工作中(zhōng)請遵從公司的(de)相應(yìng)規範進(jìn)行代(dài)碼設計(jì)。

在(zài)笔(bǐ)者(zhě)提(tí)供的(de)GVim软(ruǎn)件(jiàn)中(zhōng)打(dǎ)開(kāi)代(dài)碼後(hòu)，輸入(rù)“Zuhe”命令後(hòu)回(huí)車可(kě)得到(dào)組合邏輯的(de)代(dài)碼結構，

輸入(rù)“Shixu”命令後(hòu)回(huí)車可(kě)得到(dào)时(shí)序邏輯的(de)代(dài)碼結構。