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LVDS視頻拼接GDDR7:1 IP核生(shēng)成(chéng)例化(huà)-明(míng)德揚科教(minyingyiyuan.com)

發(fà)布(bù)时(shí)間(jiān):2019-12-10   作者(zhě):admin 浏覽量(liàng):


LVDS視頻拼接GDDR71 IP核生(shēng)成(chéng)例化(huà)


本(běn)文(wén)为(wèi)明(míng)德揚原創文(wén)章(zhāng),轉(zhuǎn)载請注明(míng)出(chū)处!作者(zhě):魚丸粗(cū)面(miàn)

由(yóu)多(duō)个(gè)數據(jù)位和(hé)时(shí)鐘(zhōng)組成(chéng)的(de)源同(tóng)步接口(kǒu)已成(chéng)为(wèi)電(diàn)子系(xì)統中(zhōng)移動(dòng)图(tú)像數據(jù)的(de)一(yī)種(zhǒng)常用(yòng)方(fāng)法。比較流行的(de)标(biāo)準是(shì)7:1 LVDS接口(kǒu)(用(yòng)于(yú)通(tòng)道(dào)鍊(liàn)路(lù)、平面(miàn)鍊(liàn)路(lù)和(hé)攝像機(jī)鍊(liàn)路(lù)),它(tā)已經(jīng)成(chéng)为(wèi)许多(duō)電(diàn)子産品的(de)通(tòng)用(yòng)标(biāo)準,包(bāo)括消費設備、工業控制、醫療和(hé)汽車遠(yuǎn)程信(xìn)息处理。在(zài)这(zhè)些應(yìng)用(yòng)中(zhōng),使用(yòng)低成(chéng)本(běn)FPGA進(jìn)行图(tú)像处理的(de)做法已經(jīng)變(biàn)得相當普遍(biàn)。特(tè)别是(shì)LatticeXP2™、LatticeECP2™、LatticeECP2M™和(hé)LatticeECP3™非(fēi)常适合支持(chí)7:1 LVDS标(biāo)準。

在(zài)明(míng)德揚的(de)一(yī)个(gè)車载視頻拼接的(de)項目中(zhōng),主(zhǔ)機(jī)收(shōu)發(fà)的(de)視頻信(xìn)息是(shì)通(tòng)过(guò)LVDS信(xìn)号(hào)進(jìn)行數據(jù)傳輸,这(zhè)就(jiù)需要(yào)有(yǒu)一(yī)个(gè)LVDS接口(kǒu)模块(kuài)来(lái)進(jìn)行數據(jù)的(de)交互,其中(zhōng)就(jiù)需要(yào)使用(yòng)到(dào)GDDR7:1 IP核。該接口(kǒu)用(yòng)于(yú)实現(xiàn)7:1 LVDS接收(shōu)接口(kǒu),使用(yòng)ECLK实現(xiàn)7:1的(de)速率變(biàn)換。ECLK是(shì)慢(màn)速时(shí)鐘(zhōng)進(jìn)来(lái)後(hòu)使用(yòng)鎖相环(huán)倍頻3.5倍後(hòu)的(de)时(shí)鐘(zhōng),此(cǐ)时(shí)鐘(zhōng)用(yòng)于(yú)捕獲接收(shōu)器IDDRX71模块(kuài)上(shàng)的(de)數據(jù)。接下(xià)来(lái)我(wǒ)来(lái)詳细(xì)介紹此(cǐ)IP核的(de)生(shēng)成(chéng)以(yǐ)及(jí)例化(huà)的(de)过(guò)程:

首先(xiān),創建一(yī)个(gè)新的(de)IP核:

找(zhǎo)到(dào)gddr7:1 IP核并進(jìn)行gddr7:1 IP核創建:

图(tú)2 創建gddr7:1 IP核

 

由(yóu)于(yú)需要(yào)8Lane差分(fēn)信(xìn)号(hào)輸入(rù),因(yīn)此(cǐ)Bus Width长度(dù)設置为(wèi)8,輸入(rù)慢(màn)速时(shí)鐘(zhōng)頻率設置为(wèi)100M

图(tú)3 gddr7:1 接收(shōu)端設置

 

IP核生(shēng)成(chéng)成(chéng)功後(hòu),點(diǎn)擊Generate,即可(kě)将生(shēng)成(chéng)後(hòu)的(de)IP核添加進(jìn)工程中(zhōng)去(qù):

图(tú)4 gddr7:1 IP核添加進(jìn)工程

 

LVDS串行數據(jù)輸入(rù)進(jìn)FPGA,經(jīng)过(guò)解(jiě)串之後(hòu)還(huán)要(yào)有(yǒu)同(tóng)步字(zì)操作,用(yòng)于(yú)數據(jù)的(de)World AlignBit Align,找(zhǎo)到(dào)數據(jù)的(de)起始位,解(jiě)串後(hòu)的(de)并行數據(jù)進(jìn)行一(yī)系(xì)列操作後(hòu)需要(yào)再轉(zhuǎn)換为(wèi)串行數據(jù)輸出(chū),这(zhè)时(shí)候需要(yào)再次(cì)例化(huà)一(yī)个(gè)gddr7:1 IP核:

图(tú)5 gddr7:1 發(fà)送端設置

 

生(shēng)成(chéng)gddr7:1發(fà)送端後(hòu),點(diǎn)擊Generate将生(shēng)成(chéng)的(de)IP核添加進(jìn)工程中(zhōng)去(qù)。

至(zhì)此(cǐ),LVDS的(de)加解(jiě)串IP核添加完成(chéng)。如(rú)有(yǒu)不(bù)明(míng)白的(de)地(dì)方(fāng)可(kě)以(yǐ)加我(wǒ)的(de)QQ3358622769,我(wǒ)将会(huì)具體(tǐ)的(de)向(xiàng)有(yǒu)需要(yào)的(de)同(tóng)学進(jìn)行指導。期(qī)待與(yǔ)大家(jiā)一(yī)起探讨進(jìn)步!

   拓展(zhǎn)閱读(dú)
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