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注意(yì)：mdyKeyScan模块(kuài)是(shì)明(míng)德揚提(tí)供的(de)IP模块(kuài)，不(bù)允许修改避免使用(yòng)时(shí)出(chū)現(xiàn)問(wèn)題(tí)，

調用(yòng)本(běn)模板时(shí)請根(gēn)據(jù)以(yǐ)下(xià)接口(kǒu)说(shuō)明(míng)進(jìn)行使用(yòng)。

一(yī)、接口(kǒu)信(xìn)号(hào)列表(biǎo)

信(xìn)号(hào)名	I/O	位宽(kuān)	定(dìng)義
clk	I	1	輸入(rù)时(shí)鐘(zhōng)信(xìn)号(hào)
rst_n	I	1	輸入(rù)複位信(xìn)号(hào)，低電(diàn)平有(yǒu)效
key_col	I	4	輸入(rù)的(de)矩阵(zhèn)按鍵的(de)列選信(xìn)号(hào)
key_row	O	KEY_W	輸出(chū)的(de)矩阵(zhèn)按鍵的(de)行選信(xìn)号(hào)
key_out	O	4	輸出(chū)的(de)矩阵(zhèn)按鍵对(duì)應(yìng)的(de)有(yǒu)效按鍵号(hào)。例如(rú)，當key_out=4'b1001=4'd9 时(shí)，表(biǎo)示第(dì)10个(gè)按鍵，即矩阵(zhèn)按鍵第(dì)三(sān)行第(dì)二(èr)列的(de)按鍵s10（其它(tā)按鍵以(yǐ)此(cǐ)類(lèi)推）。
key_vld	O	D_W	輸出(chū)的(de)按鍵有(yǒu)效指示信(xìn)号(hào)

二(èr)、接口(kǒu)使用(yòng)说(shuō)明(míng)
可(kě)以(yǐ)通(tòng)过(guò)例化(huà)以(yǐ)下(xià)參數来(lái)進(jìn)行本(běn)模块(kuài)的(de)設定(dìng)和(hé)使用(yòng)。

參數名	定(dìng)義
KEY_W	矩阵(zhèn)按鍵行數
TIME_20MS	按鍵消抖20ms需要(yào)的(de)时(shí)鐘(zhōng)周期(qī)个(gè)數

三(sān)、問(wèn)題(tí)讨論
1、

FPGA論壇	淘寶(bǎo)店(diàn)鋪	FPGA專輯庫
FPGA項目承接	B站視頻教程

認識FPGA	案(àn)例中(zhōng)心(xīn)	FPGA開(kāi)發(fà)板介紹
至(zhì)簡原理	問(wèn)題(tí)解(jiě)答(dá)

FPGA技術(shù)教程	公司公告	招聘信(xìn)息
培訓文(wén)章(zhāng)	相關(guān)信(xìn)息

14_mdyKeyScan——矩阵(zhèn)按鍵檢测模块(kuài)